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阿尔特曼一直热衷于投资核电公司,不仅自掏腰包,还偏爱亲力亲为、入驻相关公司董事会,其中Helion是阿尔特曼个人目前最大的一笔投资。 在日前举办的达沃斯世界经济论坛上,OpenAI CEO阿尔特曼(Sam Altman)表示,未来人工智能需要能源方面的突破,因为人工智能消耗的电力将远远超过人们的预期。 他称,更有利于气候变化的能源,尤其是核聚变或更便宜的太阳能以及储能,是人工智能的发展方向。“这促使我们加大对核聚变技术的投资。” 阿尔特曼早已行动起来,核聚变初创公司Helion是阿尔特曼掌权Y
芯片厂商永远不会放过 CES 的角斗场。 与往届一样,2024 年 CES 的芯片专区也开启了神兽乱斗模式。 一个更加显著的特征是,芯片战场已经从 PC、智能手机转移到了智能汽车。 无论是以英伟达为代表的从游戏起家的老牌芯片厂商,还是以安霸为代表的视觉芯片厂商,都在加码投入到智能汽车自动驾驶芯片的竞争中。 两年前,在 CES 上芯片厂商的关键词是:期货、百 Tops 算力。 2022 年 EyeQ Ultra 芯片算力也不过 176 TOPS,英伟达的自动驾驶计算架构 DRIVE Hyperi
电子发烧友网MEMS/传感技术做一个激光雷达,需要哪些基本部件? 话说回来,有没有可能自制一个激光雷达?B 站的一位硬核 UP 主「不想宅的技术宅」还真就把这个小目标实现了。 UP 主用了大半年的业余时间,用一个激光测距传感器整出了一个单线机械旋转式激光雷达,总共包括硬件设计、结构设计、FPGA 开发和 3D 打印几个步骤。对于 UP 主来说,这不算是新的挑战,只能算是「把以前学过的东西复习了一遍」: 虽然 UP 主很谦虚,但很多人播放完视频之后,只能表示「不懂,但受到震撼」: 做一个激光雷达
AI时代,我们需要重新定义和设计AI计算机。仅依靠硅基的摩尔定律,2年翻一倍的线性增长的算力供给远不能满足指数级增长的需求问题。 ChatGPT的横空出世,带来2023年全球大模型热潮。在2024年新年之际,财联社、《科创板日报》联合上海市人工智能行业协会,邀请人工智能领军者与行业精英推出“2024·AI领先者心声”系列报道,回顾过去的一年,展望新的一年AI大模型发展的机遇与挑战。墨芯人工智能CEO王维受邀采访,他向《科创板日报》记者表示: AGI将会带来一轮革命性的技术变革。这其中的核心部分
先进的存储技术即将出现,其中包括DNA存储和不可变备份,但有些技术比其他技术更远离主流应用。 数据存储行业正在经历由多种因素驱动的重大转型,其中包括对安全性、速度、效率和降低成本的需求。IT研究机构Gartner公司最近预测,到2030年,数据存储产品的出货量将增长23倍,这一轨迹有望从根本上重塑和重新定义当前的数据中心和IT运营。为了保持领先地位,企业需要密切关注以下8个存储趋势。 01 DNA存储 DNA用作数据存储介质时,承诺提供比传统存储架构更高容量和更具弹性的存储环境。DNA存储允许
(电子发烧友网 文/黄晶晶)无疑生成式AI的火热带动了互联网厂商、运营商、云服务商以及各类应用方等对数据中心、AI服务器的大力投入。同时,像中国的“东数西算”工程正构筑着坚实的算力基建。为了适应大数据、人工智能的发展,必须要解决如何增强算力、存力和运力的问题。那么高速的数据传输是不可缺少的核心环节。在此背景下,我们需要前瞻布局哪些数据传输的接口技术来适应发展呢?最近,Rambus 解决方案营销高级总监Tim Messegee接受采访,分享了他对于数据中心高速接口技术和市场的洞见。 图:Ramb
成为一名说得过去的FPGA设计者,需要练好5项基本功:仿真、综合、时序分析、调试、验证。 需要强调的一点是,以上基本功是针对FPGA设计者来说的,不是针对IC设计者的。对于IC设计,我不懂,所以不敢妄言。 对于FPGA设计者来说,练好这5项基本功,与用好相应的EDA工具是同一过程,对应关系如下: 仿真:Modelsim, Quartus II(Simulator Tool) 综合:Quartus II (Compiler Tool, RTL Viewer, Technology Map Vie
为什么需要进程 通常程序不能并发执行,因为程序并发执行的结果,是不可再现的。为了使程序,可以并发执行,且能对其加以描述和控制,引入了进程的概念。 进程的特征和定义 进程是程序的一次执行,是系统进行资源分配调度的独立单位。 结构特征:为了使程序能够独立运行,应配置一个进程控制块PCB。进程是由程序段,相关的数据段和PCB(进程控制块)三部分构成的。 动态性:进程是程序的一次执行,由创建而产生,由调度而执行,由撤销而消亡,进程存在一定的生命周期。 并发性:多个进程实体,同存在于内存中,且能在一段时
FPGA为什么有时候还需要一个时钟配置芯片提供时钟呢?FPGA(Field Programmable Gate Array)是一种可编程逻辑器件,可以根据不同需要编程,实现不同的功能。在FPGA中,时钟是很重要的一个因素,而时钟配置芯片则是为了提供时钟信号而存在。时钟是FPGA中非常重要的因素,因为FPGA必须在时钟边沿上完成一次操作。时钟信号决定了FPGA内部计算和通讯的速度,因此时钟信号的稳定性和精度至关重要。FPGA实现时钟同步通常有两种方式:一种是通过外部时钟输入,即将外部稳定的时钟信
Verilog和System Verilog是同一硬件描述语言(HDL)的同义名称。SystemVerilog是IEEE官方语言标准的较新名称,它取代了原来的Verilog名称。Verilog HDL语言最初是于1 9 8 3年由Gateway Design Automation 公司为其模拟器产品开发的硬件建模语言。那时它只是一种专用语言。专有的Verilog HDL于1989年逐渐向公众开放,并于1995年由IEEE标准化为国际标准,即IEEE Std 1364-1995TM(通常称为“V